同步多個(gè)ADC或高速數(shù)據(jù)采集卡

時(shí)鐘信號：前面板上的時(shí)鐘參考信號或通過PXI 背板提供一個(gè)通用的參考時(shí)鐘。這個(gè)共同的時(shí)鐘參考保證了同步的長期穩(wěn)定性。

有三種情況:時(shí)鐘的同步是至關(guān)重要的:

1. 在單獨(dú)的通道上進(jìn)行數(shù)據(jù)的獲取，時(shí)間戳用于測量單個(gè)脈沖的時(shí)間，并在通道之間進(jìn)行比較。

2. 記錄非常長的記錄。(例如，時(shí)鐘頻率的1ppm偏差意味著在106的記錄結(jié)束時(shí)一個(gè)采樣點(diǎn)偏差)。

3. 連續(xù)的多個(gè)板流到PC上。如果不相鎖，數(shù)據(jù)速率會有所不同。

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數(shù)據(jù)采集卡是什么芯片？

數(shù)據(jù)采集卡是實(shí)現(xiàn)模擬量轉(zhuǎn)化為數(shù)字量的模塊化硬件，控制芯片現(xiàn)在基本都是FPGA了。采樣速率和你采用什么樣的ADC芯片有關(guān)系，跟傳感器沒關(guān)系。

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高速數(shù)據(jù)采集卡應(yīng)用案例

高速數(shù)據(jù)采集方式和PCIe總線的高速數(shù)據(jù)采集卡應(yīng)是局放監(jiān)測系統(tǒng)在硬件上的發(fā)展趨勢，這種配置方式有利于局放信號的實(shí)時(shí)顯示與分析，從而有利于對局放的信號特點(diǎn)和機(jī)理作進(jìn)一步研究。

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